IT之家9月25日消息据wccftech报道，台湾半导体制造公司（TSMC）在2nm半导体制造节点的研发方面取得了重要突破：台积电有望在2023年中期进入2nm工艺的试生产阶段，并于一年后开始批量生产。
　　目前，台积电的最新制造工艺是其第一代5纳米工艺，该工艺将用于为iPhone12等设备构建处理器。
　　台积电的2nm工艺将采用差分晶体管设计。该设计被称为多桥沟道场效应（MBCFET）晶体管，它是对先前FinFET设计的补充。
　　台积电第一次作出将MBCFET设计用于其晶体管而不是交由晶圆代工厂的决定。三星于去年4月宣布了其3nm制造工艺的设计，该公司的MBCFET设计是对2017年与IBM共同开发和推出的GAAFET晶体管的改进。三星的MBCFET与GAAFET相比，前者使用纳米线。这增加了可用于传导的表面积，更重要的是，它允许设计人员在不增加横向表面积的情况下向晶体管添加更多的栅极。
　　IT之家了解到，台积电预计其2纳米工艺芯片的良率在2023年将达到惊人的90。若事实如此，那么该晶圆厂将能够很好地完善其制造工艺，并轻松地于2024年实现量产。三星在发布MBCFET时表示，预计3nm晶体管的功耗将分别比7nm降低30和45并将性能提高30。

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